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3.7
ΣΔ Converters
Two sigma delta converters provide the interface between the g-cell and the DSP. The output of each ΣΔ converter is a data
stream at a nominal frequency of 1 MHz.
g-CELL
C TOP
C BOT
α 1 =
V X
C INT1
FIRST
INTEGRATOR
z -1
1 - z -1
α 2
SECOND
INTEGRATOR
z -1
1 - z -1
1-BIT
QUANTIZER
ΣΔ _OUT
ADC
Δ C = C TOP - C BOT
β 1
β 2
V = Δ C x V X / C INT1
V = ± 2 × V REF
Figure 10. ΣΔ Converter Block Diagram
DAC
3.8
Digital Signal Processing Block
A digital signal processing (DSP) block is used to perform signal filtering and compensation operations. A diagram illustrating
the signal processing flow is shown in Figure 11 .
Arm/PCM Output
Section 3.8.9
I
To ARM
ΣΔ _OUT
A
SINC Filter
B
Low Pass Filter
C Compensation D
Interpolation
E
Offset Cancellation
F
Offset Cancellation
G
Section 3.8.10
To SPI
Section 3.8.2
Section 3.8.3
Section 3.8.6
Section 3.8.7
Section 3.8.4
Output Scaling
Figure 11. Signal Chain Diagram
Table 23. MMA685x Signal Chain Characteristics
Raw Output
Scaling
H
To SPI
Description
Sample
Time ( μ s)
Data Width
Bits
Over
Bits
Effective
Bits
Rounding
Resolution Bits
Typical Block
Latency
Reference
A
B
ΣΔ
SINC Filter
1
8
1
14
1
13
—
—
3.2 μ s
11.2 μ s
Section 3.7
Section 3.8.2
C
D
E
F
G, H
I
Low Pass Filter
Compensation
Interpolation
Offset
Cancellation
SPI Output
PCM Output
8/16
8/16
4/8
256
4/8
4/8
20
20
20
20
—
—
6
6
6
6
—
—
10
10
10
10
10
9
4
4
4
4
—
—
Reference Section 3.8.3
7.875 μ s
t s / 2
N/A
t s / 2
—
Section 3.8.3
Section 3.8.6
Section 3.8.7
Section 3.8.4
—
Section 3.8.10
MMA685x
Sensors
24
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